基于APB的UARTIP核設(shè)計(jì)與UVM驗(yàn)證.pdf_第1頁(yè)
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1、隨著集成電路性能的不斷提高，SoC芯片的規(guī)模變得越來(lái)越大，快速開發(fā)SoC產(chǎn)品以及確保SoC芯片功能的正確性變得越來(lái)越重要。隨著近幾年的技術(shù)探索，通用IP核封裝技術(shù)和UVM驗(yàn)證方法學(xué)在眾多方法中脫穎而出。因此，根據(jù)行業(yè)的發(fā)展趨勢(shì)和應(yīng)用需求，本文給出了一種基于APB總線的UART IP核，并搭建了基于UVM1.1標(biāo)準(zhǔn)的通用驗(yàn)證平臺(tái)以驗(yàn)證該IP核的正確性。
　　本文的工作包括：（1）完成了UART IP核的整體架構(gòu)設(shè)計(jì)，此IP核同時(shí)支持

2、APB總線傳輸協(xié)議和紅外接口協(xié)議，并進(jìn)行了部分功能優(yōu)化。（2）搭建了基于UVM的通用驗(yàn)證平臺(tái)，結(jié)合EDA工具增加自動(dòng)收集覆蓋率的模塊，并適配豐富的驗(yàn)證手段。（3）結(jié)合驗(yàn)證平臺(tái)和FPGA對(duì)設(shè)計(jì)的IP核進(jìn)行了詳細(xì)的驗(yàn)證工作。
　　本文設(shè)計(jì)的UART IP核，將通用的多個(gè)電路模塊封裝在一個(gè)IP核中，從硬件角度統(tǒng)一優(yōu)化，可以很好的控制電路對(duì)硬件資源的消耗，并且保證芯片性能。基于FPGA的驗(yàn)證結(jié)果顯示，本文設(shè)計(jì)的IP核占用板上資源不超過(guò)20

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