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1、應(yīng)用需求的增長(zhǎng)和系統(tǒng)芯片集成度的不斷提高,對(duì)系統(tǒng)芯片片上互連結(jié)構(gòu)提出了更高的要求??偩€結(jié)構(gòu)作為片上互連的主要方式,其實(shí)現(xiàn)目標(biāo)主要包括高性能、低功耗以及低硬件開(kāi)銷(xiāo)。性能是衡量片上總線結(jié)構(gòu)優(yōu)劣的重要指標(biāo),因而片上總線結(jié)構(gòu)的性能評(píng)價(jià)是一項(xiàng)非常重要和有意義的工作。本論文的主要工作即著重于系統(tǒng)芯片中片上總線結(jié)構(gòu)的性能評(píng)價(jià)研究,包括總線結(jié)構(gòu)的建模、系統(tǒng)仿真環(huán)境的建立以及性能評(píng)價(jià)的方法。 針對(duì)系統(tǒng)芯片中所采用的片上總線結(jié)構(gòu)特征,本文采取了基于
2、總線排隊(duì)模型和系統(tǒng)仿真模型相結(jié)合進(jìn)行性能評(píng)價(jià)的技術(shù)路線。不同于以往基于簡(jiǎn)單的經(jīng)典排隊(duì)模型的總線性能評(píng)價(jià)研究,本文面向?qū)嶋H系統(tǒng)建立了更加精確的排隊(duì)模型,在提高模型精確性的同時(shí)保持了排隊(duì)模型分析的抽象性。本文還建立了片上系統(tǒng)仿真環(huán)境,提出了基于高級(jí)語(yǔ)言c++以及基于ISS模擬器-APMulator的總線性能分析技術(shù),可作為排隊(duì)模型分析的有益補(bǔ)充。相比于類(lèi)似的研究,基于ARMulator的性能分析具有簡(jiǎn)單易用、仿真速度快、精度高等優(yōu)點(diǎn),同時(shí)硬
3、件模型的建立允許直接運(yùn)行軟件程序進(jìn)行系統(tǒng)級(jí)性能分析。針對(duì)多個(gè)實(shí)際問(wèn)題的實(shí)驗(yàn)結(jié)果表明,本文所建立的排隊(duì)模型和系統(tǒng)仿真模型是正確的,基于排隊(duì)模型和系統(tǒng)仿真模型的分析能夠?qū)崿F(xiàn)對(duì)系統(tǒng)芯片中片上總線結(jié)構(gòu)性能的定量和定性分析,為系統(tǒng)設(shè)計(jì)人員提供了有價(jià)值的參考依據(jù)。 通過(guò)排隊(duì)模型分析和基于高層仿真模型分析的結(jié)合,本文采用循序漸進(jìn)的方法分析了系統(tǒng)設(shè)計(jì)過(guò)程中面臨的多個(gè)性能評(píng)價(jià)問(wèn)題。首先對(duì)片上系統(tǒng)中類(lèi)似LCD控制器這類(lèi)的實(shí)時(shí)性主設(shè)備總線緩沖大小進(jìn)行
4、估計(jì),得出在一定的系統(tǒng)應(yīng)用背景下主設(shè)備在總線接口中緩沖的合適容量?;诟邔臃抡婺P头治龅玫降慕Y(jié)果同實(shí)際電路仿真得到的結(jié)果之差小于1﹪,基于排隊(duì)模型的分析結(jié)果同仿真分析亦十分接近;然后分析片上總線結(jié)構(gòu)中另一個(gè)重要的方面-仲裁算法,通過(guò)排隊(duì)分析方法快速地進(jìn)行了不同仲裁算法的性能對(duì)比,還計(jì)算了不同仲裁條件下的緩沖容量,結(jié)論顯示采用輪轉(zhuǎn)優(yōu)先級(jí)仲裁算法時(shí),系統(tǒng)性能相對(duì)最好;最后將研究?jī)?nèi)容擴(kuò)展到片上總線結(jié)構(gòu)的整體性能研究,包括對(duì)3種不同集成方式下的
5、DMA傳輸效能進(jìn)行了定量分析以及給出單、雙層總線結(jié)構(gòu)在性能上的比較。對(duì)DMA傳輸效能的分析結(jié)果表明采用DMA專用外設(shè)總線,可在付出不大的硬件開(kāi)銷(xiāo)的前提下獲得明顯的性能提升,且要使得DMA傳輸效率與系統(tǒng)性能獲得較好的折中,DMA的單位傳輸個(gè)數(shù)應(yīng)該有合理的取值,同時(shí)實(shí)驗(yàn)分析還再一次證明了采用輪轉(zhuǎn)優(yōu)先級(jí)算法的優(yōu)越性。在雙層總線結(jié)構(gòu)同單層總線結(jié)構(gòu)的性能對(duì)比中,實(shí)驗(yàn)結(jié)果表明系統(tǒng)中各個(gè)主設(shè)備的平均等待時(shí)間可以降低50﹪以上,且排隊(duì)分析同仿真分析得到
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