64位RISC CPU的cache設(shè)計(jì).pdf_第1頁
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文檔簡介

1、該文主要介紹了國內(nèi)第一枚64位RISC CPU--VEGA的cache特性及設(shè)計(jì).首先介紹了RISC CPU的主要特點(diǎn),與CISC架構(gòu)不同的是RISC架構(gòu)采用的是使用率較高的指令,而且所有指令長度一致,這樣非常有利于軟件硬件同時(shí)發(fā)展,因而RISC架構(gòu)應(yīng)用越來越廣泛.為了提高運(yùn)行速度,RISC架構(gòu)主要采用了兩種方法：流水線及快速緩存（cache）.五級(jí)流水線使得每條指令的平均執(zhí)行周期縮短至一至兩個(gè)周期,而cache的存在減少了內(nèi)存的存取頻

2、率,補(bǔ)充了內(nèi)存存取速度慢的不足,進(jìn)而提高運(yùn)行速度.作者參與開發(fā)的cache采用哈佛結(jié)構(gòu)--兩個(gè)分離的片內(nèi)cache：指令cache和數(shù)據(jù)cache,在cache與內(nèi)存之間還有write buffer用于兩者之間數(shù)據(jù)緩存,以保證cache與主內(nèi)存之間內(nèi)容的一直性.指令cache大小為16Kbytes,數(shù)據(jù)cache大小為8Kbytes,兩者都是直接映射,由虛擬地址索引,物理地址與cache tag相比較來確定cache line的hit/

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