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文檔簡介
1、該論文從SOC設(shè)計的角度出發(fā),設(shè)計實現(xiàn)了JPEG CODEC和靜止圖像處理器,并且成功集成在140成像素的數(shù)碼相機芯片中.JPEG CODEC的系統(tǒng)集成設(shè)計實現(xiàn)了一個壓縮和解壓縮流程硬件共享的流水線結(jié)構(gòu),建立了良好的數(shù)據(jù)傳輸和反饋機制,并且合理規(guī)劃了數(shù)據(jù)緩沖區(qū),同時在設(shè)計中部分采用容錯設(shè)計,提高了系統(tǒng)可靠性.該論文同時提出了一種新穎的二維DCT/IDCT的硬件實現(xiàn).設(shè)計在正向和逆向變換過程中對主要的算術(shù)運算單元采用硬件復(fù)用的方法,達到了
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