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1、本文設(shè)計(jì)的是一種基于上華0.6μm CMOS工藝,20MHz、10Bit的流水線型A/D轉(zhuǎn)換器。采用1.5位/級的九級流水線結(jié)構(gòu),前八級為每級1.5位的FLASH結(jié)構(gòu),第九級為2位FLASH結(jié)構(gòu),采用冗余矯正的方法進(jìn)行數(shù)字校正。首先應(yīng)用MATLAB軟件對模數(shù)轉(zhuǎn)換器進(jìn)行行為級的建模以及仿真,確定各個模塊的性能參數(shù)為后面電路設(shè)計(jì)提供依據(jù)。子模塊電路設(shè)計(jì)中主要完成了高精度的采樣保持電路、高增益帶寬的套筒式運(yùn)算放大器電路、低功耗比較器電路、1.
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