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文檔簡介
1、本文完成了函數(shù)信號發(fā)生器的設(shè)計，設(shè)計過程利用了多種設(shè)計方法和開發(fā)環(huán)境，克服了傳統(tǒng)方法的缺點，使得設(shè)計過程更加高效、便捷。本文采用直接數(shù)字頻率合成技術(shù)，以FPGA(現(xiàn)成可編程門陣列)為硬件基礎(chǔ)，通過基于FPGA的現(xiàn)代DSP系統(tǒng)設(shè)計方法完成了信號發(fā)生器的核心模塊，并利用基于NiosⅡ軟核的SOPC系統(tǒng)設(shè)計方法完成了整個項目的軟硬件設(shè)計。
論文首先概述了信號發(fā)生器的研究背景及DDS原理，然后著重介紹了DDS模塊的設(shè)計，信號發(fā)生器
2、的核心是DDS模塊，論文根據(jù)DDS原理，在Matlab/Simulink環(huán)境下對DDS信號發(fā)生模塊進(jìn)行了設(shè)計和仿真，再配合DSPBuilder中的編譯功能使圖形化建立的模塊轉(zhuǎn)換成為可以在QuartusⅡ軟件中可以使用的VHDL文件，并最終在QuartusⅡ環(huán)境中生成符號，從而實現(xiàn)設(shè)計模塊在FPGA上的實體化，使之成為整個NiosⅡ系統(tǒng)的一個模塊。該DDS模塊可生成多種信號波形，實驗結(jié)果表明，通過控制該模塊可實現(xiàn)基本波形及調(diào)制波形的產(chǎn)生，
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