vhdl課程設(shè)計(jì)--數(shù)字鐘的設(shè)計(jì)

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vhdl課程設(shè)計(jì)--數(shù)字鐘的設(shè)計(jì)_第1頁(yè)

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文檔簡(jiǎn)介

1、　　數(shù)字鐘的設(shè)計(jì)　　一、系統(tǒng)功能概述　?。ㄒ唬?、系統(tǒng)實(shí)現(xiàn)的功能：　　1、具有“時(shí)”、“分”、“秒”的十進(jìn)制數(shù)字顯示（小時(shí)從00 ~ 23）。　　2、具有手動(dòng)校時(shí)、校分、校秒的功能

2、。　　3、有定時(shí)和鬧鐘功能，能夠在設(shè)定的時(shí)間發(fā)出鬧鈴聲。　　4、能進(jìn)行整點(diǎn)報(bào)時(shí)。從59分50秒起，每隔2秒發(fā)一次低音“嘟”的信號(hào)，連續(xù)5次，最后一次為高音“嘀”的信號(hào)。　?。ǘ?、各項(xiàng)設(shè)計(jì)指標(biāo)：　　1、顯示部分采用的6個(gè)LED顯示器，從高位至低位分別顯示時(shí)、分、秒。<

3、;/p>　　2、有一個(gè)設(shè)置調(diào)鬧鐘定時(shí)時(shí)間、正常時(shí)間的按鈕，選擇調(diào)的對(duì)象。　　3、有三個(gè)按鈕分別調(diào)時(shí)、分、秒的時(shí)間。　　4、有一個(gè)按鈕用作開(kāi)啟/關(guān)閉鬧鈴。　　5、另外需要兩個(gè)時(shí)鐘信號(hào)來(lái)給系統(tǒng)提供脈沖信號(hào)，使時(shí)鐘和鬧鐘正常工作，分別為1Hz、1kHz的脈沖。<

4、p>　　二、系統(tǒng)組成以及系統(tǒng)各部分的設(shè)計(jì)　　1、系統(tǒng)結(jié)構(gòu)描述 //要求：系統(tǒng)（或頂層文件）結(jié)構(gòu)描述，各個(gè)模塊（或子程序）的功能描述；　　系統(tǒng)的頂層文件：　　頂層文件圖：（見(jiàn)下頁(yè)）　　各模塊的解釋?zhuān)?lt;/b

5、>　?。?）、7個(gè)輸入量clk_1khz、clk_1hz、key_slt、key_alarm、sec_set、min_set、hour_set：　　其中clk_1khz為鬧鈴模塊提供時(shí)鐘，處理后能產(chǎn)生“嘟”、“嘀”和變化的鬧鈴聲音；clk_1hz為計(jì)時(shí)模塊提供時(shí)鐘信號(hào)，每秒計(jì)數(shù)一次；key_slt選擇設(shè)置對(duì)象：定時(shí)或正常時(shí)間；key_alarm能夠

6、開(kāi)啟和關(guān)閉鬧鈴；sec_set、min_set、hour_set用于設(shè)置時(shí)間或定時(shí)，與key_slt相關(guān)聯(lián)。各按鍵輸出為脈沖信號(hào)。　?。?）、CNT60_A_SEC模塊：　　這個(gè)模塊式將clk_1hz這個(gè)時(shí)鐘信號(hào)進(jìn)行60進(jìn)制計(jì)數(shù)，并產(chǎn)生一個(gè)分鐘的觸發(fā)信號(hào)。該模塊能將當(dāng)前計(jì)數(shù)值實(shí)時(shí)按BCD碼的格式輸出。將該輸出接到兩位LED數(shù)碼后能時(shí)時(shí)顯示秒的狀態(tài)。通過(guò)a

7、larm_clk可以選擇設(shè)置對(duì)象為時(shí)間還是定時(shí)值。在設(shè)置時(shí)間模式上，key上的一個(gè)輸入脈沖可以將clk的輸入信號(hào)加一。在設(shè)置定時(shí)模式上，key上的脈沖只修改定時(shí)值，不影響時(shí)間脈沖clk的狀態(tài)。　　同時(shí)該模塊具有兩個(gè)輸出口out_do、out_di來(lái)觸發(fā)整點(diǎn)報(bào)時(shí)的“嘟”、“嘀”聲音。　?。?）、CNT60_A_MIN模塊：<p

8、>　　這個(gè)模塊式將CNT60_A_SEC的輸出信號(hào)進(jìn)行60進(jìn)制計(jì)數(shù)，并產(chǎn)生一個(gè)時(shí)位的觸發(fā)信號(hào)。該模塊能將當(dāng)前計(jì)數(shù)值實(shí)時(shí)按BCD碼的格式輸出。將該輸出接到兩位LED數(shù)碼后能時(shí)時(shí)顯示分的狀態(tài)。通過(guò)alarm_clk可以選擇設(shè)置對(duì)象為時(shí)間還是定時(shí)值。在設(shè)置時(shí)間模式上，key上的一個(gè)輸入脈沖可以將clk的輸入信號(hào)加一。在設(shè)置定時(shí)模式上，key上的脈沖只修改定時(shí)值，不影響時(shí)間脈沖clk的狀態(tài)。　　同

9、時(shí)該模塊具有三個(gè)輸出口out_do、out_di、out_alarm來(lái)觸發(fā)整點(diǎn)報(bào)時(shí)的“嘟”、“嘀”、鬧鈴聲音。　?。?）、CNT24_A_HOUR模塊：　　這個(gè)模塊式將CNT60_A_MIN的輸出信號(hào)做24進(jìn)制計(jì)數(shù)。該模塊能將當(dāng)前計(jì)數(shù)值實(shí)時(shí)按BCD碼的格式輸出。將該輸出接到兩位LED數(shù)碼后能時(shí)時(shí)顯示時(shí)的狀態(tài)。通過(guò)alarm_clk可以選擇設(shè)置對(duì)象為時(shí)間還

10、是定時(shí)值。在設(shè)置時(shí)間模式上，key上的一個(gè)輸入脈沖可以將clk的輸入信號(hào)加一。在設(shè)置定時(shí)模式上，key上的脈沖只修改定時(shí)值，不影響時(shí)間脈沖clk的狀態(tài)。　　同時(shí)該模塊具有一個(gè)輸出口out_alarm來(lái)觸發(fā)整點(diǎn)報(bào)時(shí)的鬧鈴聲音。　?。?）、PWM_OUT模塊：　　該模塊為PWM產(chǎn)生模塊，通過(guò)EN可開(kāi)啟和關(guān)閉PWM輸出

11、。模塊根據(jù)CLK信號(hào)二分頻產(chǎn)生的高低音，并組合，能輸出三種聲音狀態(tài)——“嘟”、“嘀”、鬧鈴。而該三種聲音要被秒、分、時(shí)的輸出觸發(fā)才能輸出PWM。　　系統(tǒng)各個(gè)模塊的VHDL程序：　　（1）、CNT60_A_SEC模塊：　　程序源代碼如下：

12、;　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity cnt60_a_sec is　　port(</p&

13、gt;　　clk,clr,enb: in std_logic;--clk：時(shí)鐘輸入信號(hào)，clr：清零端，enb：使能端　　key: in std_logic;--輸入按鍵脈沖，調(diào)整鬧鈴定時(shí)或時(shí)間　　alarm_clk: in std_logic;--1:alarm 0:clk --設(shè)置模式選擇：鬧鈴調(diào)節(jié)模式、時(shí)間調(diào)節(jié)模式</

14、p>　　qout_sl: out std_logic_vector(3 downto 0); --顯示輸出秒的低位　　qout_sh: out std_logic_vector(3 downto 0);--顯示輸出秒的高位　　co: out std_logic; --進(jìn)位輸出，觸發(fā)分計(jì)數(shù)模塊<p&

15、gt;　　out_do: out std_logic;--在整點(diǎn)報(bào)時(shí)中輸出“嘟”觸發(fā)信號(hào)　　out_di: out std_logic --在整點(diǎn)報(bào)時(shí)中輸出“嘀”觸發(fā)信號(hào)　　);　　end;　　a

16、rchitecture a of cnt60_a_sec is　　signal qout2_l:std_logic_vector(3 downto 0);　　signal qout2_h:std_logic_vector(3 downto 0);　　signal alarm_l:std_logic_vector(

17、3 downto 0);　　signal alarm_h:std_logic_vector(3 downto 0);　　signal clk1,clk2,tclk,aclk,ac_slt: std_logic;　　begin　　pro

18、cess(alarm_clk) --當(dāng)該端口輸入一個(gè)脈沖時(shí)，修改設(shè)置模式：時(shí)間調(diào)整或鬧鈴模式切換　　begin　　if alarm_clk'event and alarm_clk='1' then　　if ac_slt='0' then

19、--如果為定時(shí)模式，將改為鬧鈴模式　　ac_slt<='1';　　else　　ac_slt<='0';　　end if;<

20、p>　　end if;　　end process;　　process(key,clk,ac_slt)--根據(jù)設(shè)置模式，處理key上的脈沖信號(hào)　　begin　　if ac_slt='0

21、' then --時(shí)間調(diào)整模式　　aclk<='0';　　if clk='1' and key='1' then --clk=1則tclk<=0，通過(guò)挖洞方式添加一個(gè)脈沖　　tclk<='0';<

22、;p>　　elsif clk='0' and key='1' then --clk=0,則tclk<=1,產(chǎn)生一個(gè)高電平，添加一脈沖　　tclk<='1';　　else　　tclk<=clk;</p

23、>　　end if;　　elsif ac_slt='1' then --鬧鈴調(diào)整模式　　tclk<=clk;　　aclk<=key; --key上的脈沖直接修改鬧鈴定時(shí)值<

24、b>　　end if;　　end process;　　process(tclk,clr,enb) --60進(jìn)制計(jì)數(shù)，個(gè)位、十位放在兩個(gè)臨時(shí)變量中，表示秒的狀態(tài)　　begin　　if clr='1

25、9; then--clearing works at the state of high voltage　　qout2_l<="0000";　　qout2_h<="0000";　　elsif tclk'event and tclk='1'

26、 then　　if enb='1' then--enable works at high voltage　　if qout2_l="1001" and qout2_h="0101" then　　qout2_l<="0000";--a

27、 full mode is completed and a carryout is generated　　qout2_h<="0000";　　elsif qout2_l="1001" then　　qout2_l<="0000";</p&

28、gt;　　qout2_h<=qout2_h+1;　　else　　qout2_l<=qout2_l+1;-- in process of counting　　end if;<p

29、>　　end if;　　end if;　　end process;　　process(aclk,clr,enb)--修改鬧鈴的定時(shí)值　　begin<

30、;/p>　　if clr='1' then--clearing works at the state of high voltage　　alarm_l<="0000";　　alarm_h<="0000";　　elsif

31、 aclk'event and aclk='1' then　　if enb='1' then--enable works at high voltage　　if alarm_l="1001" and alarm_h="0101" then<p&g

32、t;　　alarm_l<="0000";--a full mode is completed and a carryout is generated　　alarm_h<="0000";　　elsif alarm_l="0101" then

33、alarm_l<="0000";　　alarm_h<=alarm_h+1;　　else　　alarm_l<=alarm_l+1;-- in process of counting

34、　　end if;　　end if;　　end if;　　end process;　　process(qout2_l,qout2_h,alarm_l,alarm_h,alarm

35、_clk)-- 產(chǎn)生進(jìn)位,顯示時(shí)間或鬧鈴定時(shí)值　　begin 　　if qout2_l="0000" and qout2_h="0000" then　　co<='1';<

36、/p>　　else 　　co<='0';　　end if;　　if ac_slt='0' then -- 顯示時(shí)間

37、　　qout_sl<=qout2_l;　　qout_sh<=qout2_h;　　else -- 顯示定時(shí)值　　qout_sh<=alarm_h;　　qout_sl<=alarm_l;&

38、lt;p>　　end if;　　end process;　　process(qout2_l,qout2_h) -- 根據(jù)秒的狀態(tài)輸出“嘟”、“嘀”觸發(fā)信號(hào)　　begin　　if qout2_

39、h="0101" then　　if qout2_l="0000" then　　out_do<='1';　　elsif qout2_l="0010" then　　out_do<='

40、;1';　　elsif qout2_l="0100" then　　out_do<='1';　　elsif qout2_l="0110" then　　out_do<='1';<

41、/p>　　elsif qout2_l="1000" then　　out_do<='1';　　else　　out_do<='0';<b&g

42、t;　　end if;　　elsif qout2_h="0000" then　　if qout2_l="0000" then　　out_di<='1';　　out_do<='0

43、';　　else 　　out_di<='0';　　end if;　　else　　out

44、_do<='0';　　out_di<='0';　　end if;　　end process;　　end;　?。?/p>

45、2）、CNT60_A_MIN模塊：　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity cnt60_a_min is<p

46、>　　port(　　clk,clr,enb: in std_logic; --clk：時(shí)鐘輸入信號(hào)，clr：清零端，enb：使能端　　key: in std_logic; --輸入按鍵脈沖，調(diào)整鬧鈴定時(shí)或時(shí)間　　alarm_clk: in std_logic; --1:

47、alarm 0:clk --設(shè)置模式選擇：鬧鈴調(diào)節(jié)模式、時(shí)間調(diào)節(jié)模式　　qout_ml: out std_logic_vector(3 downto 0); --顯示輸出分的低位　　qout_mh: out std_logic_vector(3 downto 0); --顯示輸出分的高位　　co: out std

48、_logic; --進(jìn)位輸出，觸發(fā)時(shí)計(jì)數(shù)模塊　　out_alarm:out std_logic;--鬧鈴觸發(fā)信號(hào)，時(shí)間到后輸出高電平觸發(fā)鬧鈴　　out_do,out_di: out std_logic--在整點(diǎn)報(bào)時(shí)中輸出“嘟”“嘀”觸發(fā)信號(hào)　　);&l

49、t;p>　　end;　　architecture a of cnt60_a_min is　　signal qout2_l:std_logic_vector(3 downto 0);　　signal qout2_h:std_logic_vector(3 downto 0)

50、;　　signal alarm_l:std_logic_vector(3 downto 0);　　signal alarm_h:std_logic_vector(3 downto 0);　　signal clk1,clk2,tclk,aclk,ac_slt: std_logic;<p

51、>　　begin　　process(alarm_clk) --當(dāng)該端口輸入一個(gè)脈沖時(shí)，修改設(shè)置模式：時(shí)間調(diào)整或鬧鈴模式切換　　begin　　if alarm_clk'event and alarm_clk='1

52、9; then　　if ac_slt='0' then--如果為定時(shí)模式，將改為鬧鈴模式　　ac_slt<='1';　　else　　ac_slt<='0';

53、;　　end if;　　end if;　　end process;　　process(key,clk,ac_slt) --根據(jù)設(shè)置模式，處理key上的脈沖信號(hào)

54、;　　begin　　if ac_slt='0' then --時(shí)間調(diào)整模式　　aclk<='0';　　if clk='1' and key='1' then--clk=1則tclk<=0，通過(guò)挖洞方式添加一個(gè)脈沖<

55、;/p>　　tclk<='0';　　elsif clk='0' and key='1' then--clk=0,則tclk<=1,產(chǎn)生一個(gè)高電平，添加一脈沖　　tclk<='1';　　e

56、lse　　tclk<=clk;　　end if;　　elsif ac_slt='1' then --鬧鈴調(diào)整模式　　tclk<=clk;　　ac

57、lk<=key; --key上的脈沖直接修改鬧鈴定時(shí)值　　end if;　　end process; 　　process(tclk,clr,enb) --60進(jìn)制計(jì)數(shù)，個(gè)位、十位放在兩個(gè)臨時(shí)變量中，表示分的狀態(tài)

58、　　begin　　if clr='1' then--clearing works at the state of high voltage　　qout2_l<="0000";　　qout2_h<="0000";</p&g

59、t;　　elsif tclk'event and tclk='1' then　　if enb='1' then--enable works at high voltage　　if qout2_l="1001" and qout2_h="0101" the

60、n　　qout2_l<="0000";--a full mode is completed and a carryout is generated　　qout2_h<="0000";　　elsif qout2_l="1001" then<

61、;/p>　　qout2_l<="0000";　　qout2_h<=qout2_h+1;　　else　　qout2_l<=qout2_l+1;-- in process of counting

62、　　end if;　　end if;　　end if;　　end process;　　process(aclk,clr,enb) --修

63、改鬧鈴的定時(shí)值　　begin　　if clr='1' then--clearing works at the state of high voltage　　alarm_l<="0000";

64、alarm_h<="0000";　　elsif aclk'event and aclk='1' then　　if enb='1' then--enable works at high voltage　　if alarm_l="1001&q

65、uot; and alarm_h="0101" then　　alarm_l<="0000";--a full mode is completed and a carryout is generated　　alarm_h<="0000";　　e

66、lsif alarm_l="0101" then　　alarm_l<="0000";　　alarm_h<=alarm_h+1;　　else　　alarm_l<=alarm_l+

67、1;-- in process of counting　　end if;　　end if;　　end if;　　end process;

68、　　process(qout2_l,qout2_h,alarm_l,alarm_h,alarm_clk) -- 產(chǎn)生進(jìn)位,顯示時(shí)間或鬧鈴定時(shí)值of high voltage　　begin 　　if qout2_l="0000" and qout2_h="0000&qu

69、ot; then　　co<='1';　　else 　　co<='0';　　end if;<

70、/b>　　if ac_slt='0' then　　qout_ml<=qout2_l;　　qout_mh<=qout2_h;　　else　　qout_mh<

71、;=alarm_h;　　qout_ml<=alarm_l;　　end if;　　end process;　　process(qout2_l,qout2_h,alarm_l,alarm_h) –判斷定時(shí)值與時(shí)間值相等，輸出鬧鈴觸發(fā)

72、信號(hào)　　begin 　　if qout2_l=alarm_l and qout2_h=alarm_h then　　out_alarm<='1';　　else

73、;　　out_alarm<='0';　　end if;　　end process;　　process(qout2_l,qout2_h) -- 根據(jù)分的狀態(tài)輸出“嘟”、“嘀”觸發(fā)信號(hào)<b

74、>　　begin　　if qout2_l="1001" and qout2_h="0101" then　　out_do<='1';　　else

75、out_do<='0';　　end if;　　if qout2_l="0000" and qout2_h="0000" then　　out_di<='1';<p&

76、gt;　　else　　out_di<='0';　　end if;　　end process;　　end;<

77、p>　?。?）、CNT24_A_HOUR模塊：　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity cnt24_a_hour is</p&

78、gt;　　port(　　clk,clr,enb: in std_logic; --clk：時(shí)鐘輸入信號(hào)，clr：清零端，enb：使能端　　key: in std_logic; --輸入按鍵脈沖，調(diào)整鬧鈴定時(shí)或時(shí)間　　alarm_clk: in std_l

79、ogic;--1:alarm 0:clk--設(shè)置模式選擇：鬧鈴調(diào)節(jié)模式、時(shí)間調(diào)節(jié)模式　　qout_hl: out std_logic_vector(3 downto 0); --顯示輸出時(shí)的低位　　qout_hh: out std_logic_vector(3 downto 0); --顯示輸出時(shí)的高位　　co:

80、 out std_logic; --進(jìn)位輸出　　out_alarm:out std_logi--鬧鈴觸發(fā)信號(hào)輸出　　);　　end;　　architecture a of cnt24_a_hour

81、 is　　signal qout2_l:std_logic_vector(3 downto 0);　　signal qout2_h:std_logic_vector(3 downto 0);　　signal alarm_l:std_logic_vector(3 downto 0);<

82、p>　　signal alarm_h:std_logic_vector(3 downto 0);　　signal clk1,clk2,tclk,aclk,ac_slt: std_logic;　　begin　　process(alarm_clk) --當(dāng)該端口輸入一個(gè)脈沖

83、時(shí)，修改設(shè)置模式：時(shí)間調(diào)整或鬧鈴模式切換　　begin　　if alarm_clk'event and alarm_clk='1' then　　if ac_slt='0' then--如果為定時(shí)模式，將改為鬧鈴模式

84、　　ac_slt<='1'; 　　else　　ac_slt<='0';　　end if;　　end if;<

85、/b>　　end process;　　process(key,clk,ac_slt) --根據(jù)設(shè)置模式，處理key上的脈沖信號(hào)　　begin　　if ac_slt='0' then --時(shí)間調(diào)整模式</p&

86、gt;　　aclk<='0';　　if clk='1' and key='1' then--clk=1則tclk<=0，通過(guò)挖洞方式添加一個(gè)脈沖　　tclk<='0';　　elsif clk='0

87、9; and key='1' then--clk=0,則tclk<=1,產(chǎn)生一個(gè)高電平，添加一脈沖　　tclk<='1';　　else　　tclk<=clk;　　en

88、d if;　　elsif ac_slt='1' then --鬧鈴調(diào)整模式　　tclk<=clk;　　aclk<=key; --key上的脈沖直接修改鬧鈴定時(shí)值　　end if;<

89、;/p>　　end process; 　　process(tclk,clr,enb) --24進(jìn)制計(jì)數(shù)，個(gè)位、十位放在兩個(gè)臨時(shí)變量中，表示時(shí)的狀態(tài)　　begin　　if clr='1' then--clearing works at

90、 the state of high voltage　　qout2_l<="0000";　　qout2_h<="0000";　　elsif tclk'event and tclk='1' then

91、　　if enb='1' then--enable works at high voltage　　if qout2_l="1001" then　　qout2_l<="0000";--a full mode is completed and a carryout is generated<

92、/p>　　qout2_h<=qout2_h+1;　　elsif qout2_l="0011" and qout2_h="0010" then　　qout2_l<="0000";　　qout2_h<="

93、;0000";　　else　　qout2_l<=qout2_l+1;-- in process of counting　　end if;　　end if;<

94、/b>　　end if;　　end process;　　process(aclk,clr,enb) --修改鬧鈴的定時(shí)值　　begin　　if cl

95、r='1' then--clearing works at the state of high voltage　　alarm_l<="0000";　　alarm_h<="0000";　　elsif aclk'event and aclk=

96、'1' then　　if enb='1' then--enable works at high voltage　　if alarm_l="1001" then　　alarm_l<="0000";--a full mode is comp

97、leted and a carryout is generated　　alarm_h<=qout2_h+1;　　elsif alarm_l="0011" and alarm_h="0010" then　　alarm_l<="0000";<

98、;/p>　　alarm_h<="0000";　　else　　alarm_l<=alarm_l+1;-- in process of counting　　end if;</p

99、>　　end if;　　end if;　　end process;　　process(qout2_l,qout2_h,alarm_l,alarm_h,alarm_clk) -- 產(chǎn)生進(jìn)位,顯示時(shí)間或鬧鈴定時(shí)值o

100、f high voltage　　begin 　　if qout2_l="0000" and qout2_h="0000" then　　co<='1';&

101、lt;p>　　else 　　co<='0';　　end if;　　if ac_slt='0' then　　qout

102、_hl<=qout2_l;　　qout_hh<=qout2_h;　　else　　qout_hh<=alarm_h;　　qout_hl<=alarm_l;

103、;　　end if;　　end process;　　process(qout2_l,qout2_h,alarm_l,alarm_h)--定時(shí)值與時(shí)間值相等，則輸出鬧鐘觸發(fā)信號(hào)　　begin 　　if qout2_l

104、=alarm_l and qout2_h=alarm_h then　　out_alarm<='1';　　else　　out_alarm<='0';　　end if;<

105、/b>　　end process;　　end;　　2、系統(tǒng)以及各個(gè)模塊的仿真波形　　（1）、系統(tǒng)仿真波形：　　注：由于下面的模塊仿真存在毛刺，導(dǎo)致系統(tǒng)的仿真圖有一定的問(wèn)題。</p&

106、gt;　?。?）、CNT60_A_SEC模塊：　　注：在50、52、54、56、58處有嘟觸發(fā)輸出，00處有嘀觸發(fā)輸出等。　?。?）、CNT60_A_MIN模塊：　　注：本圖展示了按鍵調(diào)節(jié)時(shí)間值和定時(shí)值的仿真波形（部分仿真圖）。　　注：該模塊的仿真波

107、形圖，具有嘟、嘀聲音觸發(fā)輸出，定時(shí)與時(shí)間相等時(shí)有鬧鈴觸發(fā)輸出等。　?。?）、CNT24_A_HOUR模塊　　注：該模塊的仿真圖，包含按鍵調(diào)整時(shí)間、定時(shí)值，鬧鐘觸發(fā)輸出等。　?。?）、PWM_OUT模塊（分三段剪切下來(lái)的，展示了三種聲音的效果）　?。?）、“嘟”、“嘀”輸出

108、波形（只有在en有脈沖，打開(kāi)PWMO后，才有效）　　注：在打開(kāi)輸出后，當(dāng)兩路嘟、嘀觸發(fā)輸入同時(shí)有效時(shí)分別輸出嘟、嘀聲音。當(dāng)兩路鬧鈴觸發(fā)同時(shí)有效時(shí)開(kāi)始鬧鈴聲音的輸出。　　注：鬧鈴輸出的變化情況（“嘀”、“嘟”交替發(fā)聲）。　　注：鬧鈴輸出的變化情況。　　3、下載時(shí)選擇的開(kāi)發(fā)系

109、統(tǒng)模式以及管腳定義　　表1 GW48-CK開(kāi)發(fā)系統(tǒng)工作模式：3　　三、課程設(shè)計(jì)過(guò)程中遇到的問(wèn)題以及解決方法　　主要是在“調(diào)整時(shí)間”和“調(diào)整定時(shí)”的上面遇到非常大的困難。與開(kāi)始想象的不一樣，一個(gè)進(jìn)程中不能加入時(shí)鐘信號(hào)，沒(méi)能夠?qū)存I脈沖直接與時(shí)鐘脈沖進(jìn)行累加。同時(shí)，在對(duì)VHDL的語(yǔ)法的熟悉上也花費(fèi)了大量的時(shí)間。<

110、;/p>　　最后的解決方法是，通過(guò)另一個(gè)進(jìn)程，先將這兩個(gè)信號(hào)進(jìn)行處理后，分別產(chǎn)生aclk和tclk分別為定時(shí)調(diào)整部分、和時(shí)間調(diào)整部分提供時(shí)鐘信號(hào)。調(diào)整按鍵的脈沖信號(hào)和正常的時(shí)鐘信號(hào)不是按照簡(jiǎn)單的或運(yùn)算來(lái)處理的。　　1）、如果要調(diào)整時(shí)間：　　當(dāng)時(shí)鐘信號(hào)是高電平，按鍵信號(hào)也是高電平時(shí)，則給tclk賦值0。&

111、lt;p>　　當(dāng)時(shí)鐘信號(hào)是高電平，按鍵信號(hào)是低電平時(shí)，則給tclk賦值1。　　當(dāng)時(shí)鐘信號(hào)是低電平，按鍵信號(hào)是高電平時(shí)，則給tclk賦值1。　　當(dāng)時(shí)鐘信號(hào)是低電平，按鍵信號(hào)是低電平是，則給tclk賦值0。　　這樣無(wú)論按鍵脈沖是在高電平還是低電平，或者是在高低電平兩種狀態(tài)下出現(xiàn)，其最終結(jié)果都是會(huì)多產(chǎn)生一個(gè)脈沖信

112、號(hào)，導(dǎo)致計(jì)數(shù)值變化，達(dá)到修改時(shí)間的目的。期間，aclk始終不變。　　2）、如果要調(diào)整定時(shí)：　　1、時(shí)鐘輸入信號(hào)賦值給tclk　　2、按鍵輸入信號(hào)賦值給aclk　　這樣，當(dāng)按鍵脈沖結(jié)束時(shí)，定時(shí)調(diào)整信號(hào)會(huì)出現(xiàn)一個(gè)脈沖。而時(shí)鐘信號(hào)不受影響。<p&g

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