數(shù)據(jù)包緩存管理單元的ASIC設計與實現(xiàn).pdf_第1頁
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文檔簡介

1、隨著高速網(wǎng)絡的不斷發(fā)展，網(wǎng)絡設備的處理數(shù)據(jù)量不斷增大，傳統(tǒng)的緩存管理機制由于存儲空間利用率低下，已無法滿足大數(shù)據(jù)量緩存管理的要求。本文提出了一種基于單元鏈表控制的可隨機讀寫數(shù)據(jù)緩存管理實現(xiàn)，該實現(xiàn)具有較高的存儲空間利用率，且兼具“低成本”,“高存儲帶寬”,“平臺通用性”等優(yōu)點，是一種高性能的硬件緩存管理實現(xiàn)。 本文首先介紹了三種傳統(tǒng)的數(shù)據(jù)包緩存管理機制，由此引出了可隨機讀寫數(shù)據(jù)緩存管理控制技術。在此基礎上針對寬帶IP網(wǎng)絡監(jiān)控系統(tǒng)

2、的需求，提出了一個基于硬件實現(xiàn)的高速數(shù)據(jù)緩存管理的ASIC設計解決方案。在該設計方案中將數(shù)據(jù)包分割成128字節(jié)大小的單元，通過由高速的SSRAM維護讀寫單元鏈表而實現(xiàn)對存儲空間的隨機讀寫訪問，提高了數(shù)據(jù)包存儲器的利用率；而通過將數(shù)據(jù)包保存在FCRAM（一種低成本的DDR SDRAM），又滿足了低成本的要求。同時本文還針對實際應用的特點，提出了一系列旨在提高存儲器讀寫訪問帶寬以及對不同種類型SSRAM兼容的設計解決方案，保證了緩存管理單元

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